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MRF49XA
5.1
Timing Specification and Diagram
TABLE 5-8:
SPI TIMING SPECIFICATION
Symbol
t CH
t CL
t SS
t SH
t SHI
t DS
t DH
t OD
Parameter
Clock High Time
Clock Low Time
Select Setup Time (CS falling edge to SCK rising edge)
Select Hold Time (SCK falling edge to CS rising edge)
Select High Time
Data Setup Time (SDI transition to SCK rising edge)
Data Hold Time (SCK rising edge to SDI transition)
Data Delay Time
Minimum Value (ns)
25
25
10
10
25
5
5
10
FIGURE 5-1:
t SS
CS
SPI TIMING DIAGRAM
t SHI
t CH
t CL
t CD
t SH
SCK
t DS
t DH
SDI
SDO
BIT 15
TXRXFIFO
BIT 14
POR
BIT 13
BIT 8
TXOWRXOF
BIT 7
DQDO
BIT 1
OFFSB(0)
BIT 0
FIFO OUT
ATRSSI
DS70590C-page 84
Preliminary
? 2009-2011 Microchip Technology Inc.
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